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synced 2024-08-19 21:52:22 +00:00
Implement Frsqrte_S (#72)
* Implement Frsqrte_S * Implement Frsqrte_V * Add Frsqrte_S test
This commit is contained in:
parent
4c19c908e5
commit
39f20d8d1a
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@ -225,6 +225,8 @@ namespace ChocolArm64
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Set("0>0011101<100001100010xxxxxxxxxx", AInstEmit.Frintp_V, typeof(AOpCodeSimd));
|
Set("0>0011101<100001100010xxxxxxxxxx", AInstEmit.Frintp_V, typeof(AOpCodeSimd));
|
||||||
Set("000111100x100111010000xxxxxxxxxx", AInstEmit.Frintx_S, typeof(AOpCodeSimd));
|
Set("000111100x100111010000xxxxxxxxxx", AInstEmit.Frintx_S, typeof(AOpCodeSimd));
|
||||||
Set("0>1011100<100001100110xxxxxxxxxx", AInstEmit.Frintx_V, typeof(AOpCodeSimd));
|
Set("0>1011100<100001100110xxxxxxxxxx", AInstEmit.Frintx_V, typeof(AOpCodeSimd));
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||||||
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Set("011111101x100001110110xxxxxxxxxx", AInstEmit.Frsqrte_S, typeof(AOpCodeSimd));
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||||||
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Set("0>1011101<100001110110xxxxxxxxxx", AInstEmit.Frsqrte_V, typeof(AOpCodeSimd));
|
||||||
Set("000111100x100001110000xxxxxxxxxx", AInstEmit.Fsqrt_S, typeof(AOpCodeSimd));
|
Set("000111100x100001110000xxxxxxxxxx", AInstEmit.Fsqrt_S, typeof(AOpCodeSimd));
|
||||||
Set("000111100x1xxxxx001110xxxxxxxxxx", AInstEmit.Fsub_S, typeof(AOpCodeSimdReg));
|
Set("000111100x1xxxxx001110xxxxxxxxxx", AInstEmit.Fsub_S, typeof(AOpCodeSimdReg));
|
||||||
Set("0>0011101<1xxxxx110101xxxxxxxxxx", AInstEmit.Fsub_V, typeof(AOpCodeSimdReg));
|
Set("0>0011101<1xxxxx110101xxxxxxxxxx", AInstEmit.Fsub_V, typeof(AOpCodeSimdReg));
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@ -476,6 +476,22 @@ namespace ChocolArm64.Instruction
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||||||
});
|
});
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}
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}
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public static void Frsqrte_S(AILEmitterCtx Context)
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{
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EmitScalarUnaryOpF(Context, () =>
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{
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|
EmitUnarySoftFloatCall(Context, nameof(ASoftFloat.InvSqrtEstimate));
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||||||
|
});
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}
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public static void Frsqrte_V(AILEmitterCtx Context)
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{
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|
EmitVectorUnaryOpF(Context, () =>
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|
{
|
||||||
|
EmitUnarySoftFloatCall(Context, nameof(ASoftFloat.InvSqrtEstimate));
|
||||||
|
});
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|
}
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public static void Fsqrt_S(AILEmitterCtx Context)
|
public static void Fsqrt_S(AILEmitterCtx Context)
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{
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{
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EmitScalarUnaryOpF(Context, () =>
|
EmitScalarUnaryOpF(Context, () =>
|
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@ -100,6 +100,26 @@ namespace ChocolArm64.Instruction
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Context.EmitCall(MthdInfo);
|
Context.EmitCall(MthdInfo);
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}
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}
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public static void EmitUnarySoftFloatCall(AILEmitterCtx Context, string Name)
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{
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IAOpCodeSimd Op = (IAOpCodeSimd)Context.CurrOp;
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int SizeF = Op.Size & 1;
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MethodInfo MthdInfo;
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if (SizeF == 0)
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{
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|
MthdInfo = typeof(ASoftFloat).GetMethod(Name, new Type[] { typeof(float) });
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|
}
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|
else /* if (SizeF == 1) */
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{
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|
MthdInfo = typeof(ASoftFloat).GetMethod(Name, new Type[] { typeof(double) });
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|
}
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|
Context.EmitCall(MthdInfo);
|
||||||
|
}
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public static void EmitScalarUnaryOpSx(AILEmitterCtx Context, Action Emit)
|
public static void EmitScalarUnaryOpSx(AILEmitterCtx Context, Action Emit)
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||||||
{
|
{
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EmitScalarOp(Context, Emit, OperFlags.Rn, true);
|
EmitScalarOp(Context, Emit, OperFlags.Rn, true);
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||||||
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103
ChocolArm64/Instruction/ASoftFloat.cs
Normal file
103
ChocolArm64/Instruction/ASoftFloat.cs
Normal file
|
@ -0,0 +1,103 @@
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using System;
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namespace ChocolArm64.Instruction
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{
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static class ASoftFloat
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{
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static ASoftFloat()
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{
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InvSqrtEstimateTable = BuildInvSqrtEstimateTable();
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}
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private static readonly byte[] InvSqrtEstimateTable;
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private static byte[] BuildInvSqrtEstimateTable()
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{
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|
byte[] Table = new byte[512];
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for (ulong index = 128; index < 512; index++)
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{
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|
ulong a = index;
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if (a < 256)
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{
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a = (a << 1) + 1;
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|
}
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else
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{
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|
a = (a | 1) << 1;
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|
}
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ulong b = 256;
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while (a * (b + 1) * (b + 1) < (1ul << 28))
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{
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b++;
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|
}
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|
b = (b + 1) >> 1;
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Table[index] = (byte)(b & 0xFF);
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}
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return Table;
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}
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public static float InvSqrtEstimate(float x)
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{
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return (float)InvSqrtEstimate((double)x);
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}
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public static double InvSqrtEstimate(double x)
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{
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ulong x_bits = (ulong)BitConverter.DoubleToInt64Bits(x);
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|
ulong x_sign = x_bits & 0x8000000000000000;
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||||||
|
long x_exp = (long)((x_bits >> 52) & 0x7FF);
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|
ulong scaled = x_bits & ((1ul << 52) - 1);
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|
if (x_exp == 0x7ff)
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{
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|
if (scaled == 0)
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|
{
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// Infinity -> Zero
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return BitConverter.Int64BitsToDouble((long)x_sign);
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|
}
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|
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|
// NaN
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|
return BitConverter.Int64BitsToDouble((long)(x_bits | 0x0008000000000000));
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|
}
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|
|
||||||
|
if (x_exp == 0)
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||||||
|
{
|
||||||
|
if (scaled == 0)
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||||||
|
{
|
||||||
|
// Zero -> Infinity
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||||||
|
return BitConverter.Int64BitsToDouble((long)(x_sign | 0x7ff0000000000000));
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||||||
|
}
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// Denormal
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while ((scaled & (1 << 51)) == 0)
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|
{
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scaled <<= 1;
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|
x_exp--;
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|
}
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||||||
|
scaled <<= 1;
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|
}
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|
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if (((ulong)x_exp & 1) == 1)
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|
{
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|
scaled >>= 45;
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|
scaled &= 0xFF;
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scaled |= 0x80;
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|
}
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|
else
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|
{
|
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|
scaled >>= 44;
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||||||
|
scaled &= 0xFF;
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||||||
|
scaled |= 0x100;
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|
}
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ulong result_exp = ((ulong)(3068 - x_exp) / 2) & 0x7FF;
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ulong estimate = (ulong)InvSqrtEstimateTable[scaled];
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ulong fraction = estimate << 44;
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ulong result = x_sign | (result_exp << 52) | fraction;
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|
return BitConverter.Int64BitsToDouble((long)result);
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|
}
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|
}
|
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|
}
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@ -618,5 +618,13 @@ namespace Ryujinx.Tests.Cpu
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Assert.AreEqual(Result1, ThreadState.V0.X1);
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Assert.AreEqual(Result1, ThreadState.V0.X1);
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});
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});
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}
|
}
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[TestCase(0x41200000u, 0x3EA18000u)]
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public void Frsqrte_S(uint A, uint Result)
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|
{
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AVec V1 = new AVec { X0 = A };
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||||||
|
AThreadState ThreadState = SingleOpcode(0x7EA1D820, V1: V1);
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||||||
|
Assert.AreEqual(Result, ThreadState.V0.X0);
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||||||
|
}
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}
|
}
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}
|
}
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