mirror of
https://github.com/yuzu-emu/unicorn.git
synced 2025-01-11 11:45:39 +00:00
target/riscv: vector integer comparison instructions
1366fc79be04fa56a0e3f078ba4f26c27ac67e89
This commit is contained in:
parent
244793c4e8
commit
965af9986a
qemu
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@ -6410,6 +6410,62 @@ riscv_symbols = (
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|||
'helper_vsra_vx_h',
|
||||
'helper_vsra_vx_w',
|
||||
'helper_vsra_vx_d',
|
||||
'helper_vmseq_vv_b',
|
||||
'helper_vmseq_vv_h',
|
||||
'helper_vmseq_vv_w',
|
||||
'helper_vmseq_vv_d',
|
||||
'helper_vmsne_vv_b',
|
||||
'helper_vmsne_vv_h',
|
||||
'helper_vmsne_vv_w',
|
||||
'helper_vmsne_vv_d',
|
||||
'helper_vmsltu_vv_b',
|
||||
'helper_vmsltu_vv_h',
|
||||
'helper_vmsltu_vv_w',
|
||||
'helper_vmsltu_vv_d',
|
||||
'helper_vmslt_vv_b',
|
||||
'helper_vmslt_vv_h',
|
||||
'helper_vmslt_vv_w',
|
||||
'helper_vmslt_vv_d',
|
||||
'helper_vmsleu_vv_b',
|
||||
'helper_vmsleu_vv_h',
|
||||
'helper_vmsleu_vv_w',
|
||||
'helper_vmsleu_vv_d',
|
||||
'helper_vmsle_vv_b',
|
||||
'helper_vmsle_vv_h',
|
||||
'helper_vmsle_vv_w',
|
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'helper_vmsle_vv_d',
|
||||
'helper_vmseq_vx_b',
|
||||
'helper_vmseq_vx_h',
|
||||
'helper_vmseq_vx_w',
|
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'helper_vmseq_vx_d',
|
||||
'helper_vmsne_vx_b',
|
||||
'helper_vmsne_vx_h',
|
||||
'helper_vmsne_vx_w',
|
||||
'helper_vmsne_vx_d',
|
||||
'helper_vmsltu_vx_b',
|
||||
'helper_vmsltu_vx_h',
|
||||
'helper_vmsltu_vx_w',
|
||||
'helper_vmsltu_vx_d',
|
||||
'helper_vmslt_vx_b',
|
||||
'helper_vmslt_vx_h',
|
||||
'helper_vmslt_vx_w',
|
||||
'helper_vmslt_vx_d',
|
||||
'helper_vmsleu_vx_b',
|
||||
'helper_vmsleu_vx_h',
|
||||
'helper_vmsleu_vx_w',
|
||||
'helper_vmsleu_vx_d',
|
||||
'helper_vmsle_vx_b',
|
||||
'helper_vmsle_vx_h',
|
||||
'helper_vmsle_vx_w',
|
||||
'helper_vmsle_vx_d',
|
||||
'helper_vmsgtu_vx_b',
|
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'helper_vmsgtu_vx_h',
|
||||
'helper_vmsgtu_vx_w',
|
||||
'helper_vmsgtu_vx_d',
|
||||
'helper_vmsgt_vx_b',
|
||||
'helper_vmsgt_vx_h',
|
||||
'helper_vmsgt_vx_w',
|
||||
'helper_vmsgt_vx_d',
|
||||
'pmp_hart_has_privs',
|
||||
'pmpaddr_csr_read',
|
||||
'pmpaddr_csr_write',
|
||||
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@ -3840,6 +3840,30 @@
|
|||
#define helper_vxor_vx_h helper_vxor_vx_h_riscv32
|
||||
#define helper_vxor_vx_w helper_vxor_vx_w_riscv32
|
||||
#define helper_vxor_vx_d helper_vxor_vx_d_riscv32
|
||||
#define helper_vsll_vv_b helper_vsll_vv_b_riscv32
|
||||
#define helper_vsll_vv_h helper_vsll_vv_h_riscv32
|
||||
#define helper_vsll_vv_w helper_vsll_vv_w_riscv32
|
||||
#define helper_vsll_vv_d helper_vsll_vv_d_riscv32
|
||||
#define helper_vsrl_vv_b helper_vsrl_vv_b_riscv32
|
||||
#define helper_vsrl_vv_h helper_vsrl_vv_h_riscv32
|
||||
#define helper_vsrl_vv_w helper_vsrl_vv_w_riscv32
|
||||
#define helper_vsrl_vv_d helper_vsrl_vv_d_riscv32
|
||||
#define helper_vsra_vv_b helper_vsra_vv_b_riscv32
|
||||
#define helper_vsra_vv_h helper_vsra_vv_h_riscv32
|
||||
#define helper_vsra_vv_w helper_vsra_vv_w_riscv32
|
||||
#define helper_vsra_vv_d helper_vsra_vv_d_riscv32
|
||||
#define helper_vsll_vx_b helper_vsll_vx_b_riscv32
|
||||
#define helper_vsll_vx_h helper_vsll_vx_h_riscv32
|
||||
#define helper_vsll_vx_w helper_vsll_vx_w_riscv32
|
||||
#define helper_vsll_vx_d helper_vsll_vx_d_riscv32
|
||||
#define helper_vsrl_vx_b helper_vsrl_vx_b_riscv32
|
||||
#define helper_vsrl_vx_h helper_vsrl_vx_h_riscv32
|
||||
#define helper_vsrl_vx_w helper_vsrl_vx_w_riscv32
|
||||
#define helper_vsrl_vx_d helper_vsrl_vx_d_riscv32
|
||||
#define helper_vsra_vx_b helper_vsra_vx_b_riscv32
|
||||
#define helper_vsra_vx_h helper_vsra_vx_h_riscv32
|
||||
#define helper_vsra_vx_w helper_vsra_vx_w_riscv32
|
||||
#define helper_vsra_vx_d helper_vsra_vx_d_riscv32
|
||||
#define pmp_hart_has_privs pmp_hart_has_privs_riscv32
|
||||
#define pmpaddr_csr_read pmpaddr_csr_read_riscv32
|
||||
#define pmpaddr_csr_write pmpaddr_csr_write_riscv32
|
||||
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@ -3840,6 +3840,30 @@
|
|||
#define helper_vxor_vx_h helper_vxor_vx_h_riscv64
|
||||
#define helper_vxor_vx_w helper_vxor_vx_w_riscv64
|
||||
#define helper_vxor_vx_d helper_vxor_vx_d_riscv64
|
||||
#define helper_vsll_vv_b helper_vsll_vv_b_riscv64
|
||||
#define helper_vsll_vv_h helper_vsll_vv_h_riscv64
|
||||
#define helper_vsll_vv_w helper_vsll_vv_w_riscv64
|
||||
#define helper_vsll_vv_d helper_vsll_vv_d_riscv64
|
||||
#define helper_vsrl_vv_b helper_vsrl_vv_b_riscv64
|
||||
#define helper_vsrl_vv_h helper_vsrl_vv_h_riscv64
|
||||
#define helper_vsrl_vv_w helper_vsrl_vv_w_riscv64
|
||||
#define helper_vsrl_vv_d helper_vsrl_vv_d_riscv64
|
||||
#define helper_vsra_vv_b helper_vsra_vv_b_riscv64
|
||||
#define helper_vsra_vv_h helper_vsra_vv_h_riscv64
|
||||
#define helper_vsra_vv_w helper_vsra_vv_w_riscv64
|
||||
#define helper_vsra_vv_d helper_vsra_vv_d_riscv64
|
||||
#define helper_vsll_vx_b helper_vsll_vx_b_riscv64
|
||||
#define helper_vsll_vx_h helper_vsll_vx_h_riscv64
|
||||
#define helper_vsll_vx_w helper_vsll_vx_w_riscv64
|
||||
#define helper_vsll_vx_d helper_vsll_vx_d_riscv64
|
||||
#define helper_vsrl_vx_b helper_vsrl_vx_b_riscv64
|
||||
#define helper_vsrl_vx_h helper_vsrl_vx_h_riscv64
|
||||
#define helper_vsrl_vx_w helper_vsrl_vx_w_riscv64
|
||||
#define helper_vsrl_vx_d helper_vsrl_vx_d_riscv64
|
||||
#define helper_vsra_vx_b helper_vsra_vx_b_riscv64
|
||||
#define helper_vsra_vx_h helper_vsra_vx_h_riscv64
|
||||
#define helper_vsra_vx_w helper_vsra_vx_w_riscv64
|
||||
#define helper_vsra_vx_d helper_vsra_vx_d_riscv64
|
||||
#define pmp_hart_has_privs pmp_hart_has_privs_riscv64
|
||||
#define pmpaddr_csr_read pmpaddr_csr_read_riscv64
|
||||
#define pmpaddr_csr_write pmpaddr_csr_write_riscv64
|
||||
|
|
|
@ -435,3 +435,60 @@ DEF_HELPER_6(vsra_vx_b, void, ptr, ptr, tl, ptr, env, i32)
|
|||
DEF_HELPER_6(vsra_vx_h, void, ptr, ptr, tl, ptr, env, i32)
|
||||
DEF_HELPER_6(vsra_vx_w, void, ptr, ptr, tl, ptr, env, i32)
|
||||
DEF_HELPER_6(vsra_vx_d, void, ptr, ptr, tl, ptr, env, i32)
|
||||
|
||||
DEF_HELPER_6(vmseq_vv_b, void, ptr, ptr, ptr, ptr, env, i32)
|
||||
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|
||||
DEF_HELPER_6(vmseq_vv_w, void, ptr, ptr, ptr, ptr, env, i32)
|
||||
DEF_HELPER_6(vmseq_vv_d, void, ptr, ptr, ptr, ptr, env, i32)
|
||||
DEF_HELPER_6(vmsne_vv_b, void, ptr, ptr, ptr, ptr, env, i32)
|
||||
DEF_HELPER_6(vmsne_vv_h, void, ptr, ptr, ptr, ptr, env, i32)
|
||||
DEF_HELPER_6(vmsne_vv_w, void, ptr, ptr, ptr, ptr, env, i32)
|
||||
DEF_HELPER_6(vmsne_vv_d, void, ptr, ptr, ptr, ptr, env, i32)
|
||||
DEF_HELPER_6(vmsltu_vv_b, void, ptr, ptr, ptr, ptr, env, i32)
|
||||
DEF_HELPER_6(vmsltu_vv_h, void, ptr, ptr, ptr, ptr, env, i32)
|
||||
DEF_HELPER_6(vmsltu_vv_w, void, ptr, ptr, ptr, ptr, env, i32)
|
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DEF_HELPER_6(vmsltu_vv_d, void, ptr, ptr, ptr, ptr, env, i32)
|
||||
DEF_HELPER_6(vmslt_vv_b, void, ptr, ptr, ptr, ptr, env, i32)
|
||||
DEF_HELPER_6(vmslt_vv_h, void, ptr, ptr, ptr, ptr, env, i32)
|
||||
DEF_HELPER_6(vmslt_vv_w, void, ptr, ptr, ptr, ptr, env, i32)
|
||||
DEF_HELPER_6(vmslt_vv_d, void, ptr, ptr, ptr, ptr, env, i32)
|
||||
DEF_HELPER_6(vmsleu_vv_b, void, ptr, ptr, ptr, ptr, env, i32)
|
||||
DEF_HELPER_6(vmsleu_vv_h, void, ptr, ptr, ptr, ptr, env, i32)
|
||||
DEF_HELPER_6(vmsleu_vv_w, void, ptr, ptr, ptr, ptr, env, i32)
|
||||
DEF_HELPER_6(vmsleu_vv_d, void, ptr, ptr, ptr, ptr, env, i32)
|
||||
DEF_HELPER_6(vmsle_vv_b, void, ptr, ptr, ptr, ptr, env, i32)
|
||||
DEF_HELPER_6(vmsle_vv_h, void, ptr, ptr, ptr, ptr, env, i32)
|
||||
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|
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DEF_HELPER_6(vmsle_vv_d, void, ptr, ptr, ptr, ptr, env, i32)
|
||||
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|
||||
DEF_HELPER_6(vmseq_vx_h, void, ptr, ptr, tl, ptr, env, i32)
|
||||
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|
||||
DEF_HELPER_6(vmseq_vx_d, void, ptr, ptr, tl, ptr, env, i32)
|
||||
DEF_HELPER_6(vmsne_vx_b, void, ptr, ptr, tl, ptr, env, i32)
|
||||
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|
||||
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|
||||
DEF_HELPER_6(vmsne_vx_d, void, ptr, ptr, tl, ptr, env, i32)
|
||||
DEF_HELPER_6(vmsltu_vx_b, void, ptr, ptr, tl, ptr, env, i32)
|
||||
DEF_HELPER_6(vmsltu_vx_h, void, ptr, ptr, tl, ptr, env, i32)
|
||||
DEF_HELPER_6(vmsltu_vx_w, void, ptr, ptr, tl, ptr, env, i32)
|
||||
DEF_HELPER_6(vmsltu_vx_d, void, ptr, ptr, tl, ptr, env, i32)
|
||||
DEF_HELPER_6(vmslt_vx_b, void, ptr, ptr, tl, ptr, env, i32)
|
||||
DEF_HELPER_6(vmslt_vx_h, void, ptr, ptr, tl, ptr, env, i32)
|
||||
DEF_HELPER_6(vmslt_vx_w, void, ptr, ptr, tl, ptr, env, i32)
|
||||
DEF_HELPER_6(vmslt_vx_d, void, ptr, ptr, tl, ptr, env, i32)
|
||||
DEF_HELPER_6(vmsleu_vx_b, void, ptr, ptr, tl, ptr, env, i32)
|
||||
DEF_HELPER_6(vmsleu_vx_h, void, ptr, ptr, tl, ptr, env, i32)
|
||||
DEF_HELPER_6(vmsleu_vx_w, void, ptr, ptr, tl, ptr, env, i32)
|
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DEF_HELPER_6(vmsleu_vx_d, void, ptr, ptr, tl, ptr, env, i32)
|
||||
DEF_HELPER_6(vmsle_vx_b, void, ptr, ptr, tl, ptr, env, i32)
|
||||
DEF_HELPER_6(vmsle_vx_h, void, ptr, ptr, tl, ptr, env, i32)
|
||||
DEF_HELPER_6(vmsle_vx_w, void, ptr, ptr, tl, ptr, env, i32)
|
||||
DEF_HELPER_6(vmsle_vx_d, void, ptr, ptr, tl, ptr, env, i32)
|
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DEF_HELPER_6(vmsgtu_vx_b, void, ptr, ptr, tl, ptr, env, i32)
|
||||
DEF_HELPER_6(vmsgtu_vx_h, void, ptr, ptr, tl, ptr, env, i32)
|
||||
DEF_HELPER_6(vmsgtu_vx_w, void, ptr, ptr, tl, ptr, env, i32)
|
||||
DEF_HELPER_6(vmsgtu_vx_d, void, ptr, ptr, tl, ptr, env, i32)
|
||||
DEF_HELPER_6(vmsgt_vx_b, void, ptr, ptr, tl, ptr, env, i32)
|
||||
DEF_HELPER_6(vmsgt_vx_h, void, ptr, ptr, tl, ptr, env, i32)
|
||||
DEF_HELPER_6(vmsgt_vx_w, void, ptr, ptr, tl, ptr, env, i32)
|
||||
DEF_HELPER_6(vmsgt_vx_d, void, ptr, ptr, tl, ptr, env, i32)
|
||||
|
|
|
@ -331,6 +331,26 @@ vsrl_vi 101000 . ..... ..... 011 ..... 1010111 @r_vm
|
|||
vsra_vv 101001 . ..... ..... 000 ..... 1010111 @r_vm
|
||||
vsra_vx 101001 . ..... ..... 100 ..... 1010111 @r_vm
|
||||
vsra_vi 101001 . ..... ..... 011 ..... 1010111 @r_vm
|
||||
vmseq_vv 011000 . ..... ..... 000 ..... 1010111 @r_vm
|
||||
vmseq_vx 011000 . ..... ..... 100 ..... 1010111 @r_vm
|
||||
vmseq_vi 011000 . ..... ..... 011 ..... 1010111 @r_vm
|
||||
vmsne_vv 011001 . ..... ..... 000 ..... 1010111 @r_vm
|
||||
vmsne_vx 011001 . ..... ..... 100 ..... 1010111 @r_vm
|
||||
vmsne_vi 011001 . ..... ..... 011 ..... 1010111 @r_vm
|
||||
vmsltu_vv 011010 . ..... ..... 000 ..... 1010111 @r_vm
|
||||
vmsltu_vx 011010 . ..... ..... 100 ..... 1010111 @r_vm
|
||||
vmslt_vv 011011 . ..... ..... 000 ..... 1010111 @r_vm
|
||||
vmslt_vx 011011 . ..... ..... 100 ..... 1010111 @r_vm
|
||||
vmsleu_vv 011100 . ..... ..... 000 ..... 1010111 @r_vm
|
||||
vmsleu_vx 011100 . ..... ..... 100 ..... 1010111 @r_vm
|
||||
vmsleu_vi 011100 . ..... ..... 011 ..... 1010111 @r_vm
|
||||
vmsle_vv 011101 . ..... ..... 000 ..... 1010111 @r_vm
|
||||
vmsle_vx 011101 . ..... ..... 100 ..... 1010111 @r_vm
|
||||
vmsle_vi 011101 . ..... ..... 011 ..... 1010111 @r_vm
|
||||
vmsgtu_vx 011110 . ..... ..... 100 ..... 1010111 @r_vm
|
||||
vmsgtu_vi 011110 . ..... ..... 011 ..... 1010111 @r_vm
|
||||
vmsgt_vx 011111 . ..... ..... 100 ..... 1010111 @r_vm
|
||||
vmsgt_vi 011111 . ..... ..... 011 ..... 1010111 @r_vm
|
||||
|
||||
vsetvli 0 ........... ..... 111 ..... 1010111 @r2_zimm
|
||||
vsetvl 1000000 ..... ..... 111 ..... 1010111 @r
|
||||
|
|
|
@ -1446,3 +1446,49 @@ GEN_OPIVX_GVEC_SHIFT_TRANS(vsra_vx, sars)
|
|||
GEN_OPIVI_GVEC_TRANS(vsll_vi, 1, vsll_vx, shli)
|
||||
GEN_OPIVI_GVEC_TRANS(vsrl_vi, 1, vsrl_vx, shri)
|
||||
GEN_OPIVI_GVEC_TRANS(vsra_vi, 1, vsra_vx, sari)
|
||||
|
||||
/* Vector Integer Comparison Instructions */
|
||||
/*
|
||||
* For all comparison instructions, an illegal instruction exception is raised
|
||||
* if the destination vector register overlaps a source vector register group
|
||||
* and LMUL > 1.
|
||||
*/
|
||||
static bool opivv_cmp_check(DisasContext *s, arg_rmrr *a)
|
||||
{
|
||||
return (vext_check_isa_ill(s) &&
|
||||
vext_check_reg(s, a->rs2, false) &&
|
||||
vext_check_reg(s, a->rs1, false) &&
|
||||
((vext_check_overlap_group(a->rd, 1, a->rs1, 1 << s->lmul) &&
|
||||
vext_check_overlap_group(a->rd, 1, a->rs2, 1 << s->lmul)) ||
|
||||
(s->lmul == 0)));
|
||||
}
|
||||
GEN_OPIVV_TRANS(vmseq_vv, opivv_cmp_check)
|
||||
GEN_OPIVV_TRANS(vmsne_vv, opivv_cmp_check)
|
||||
GEN_OPIVV_TRANS(vmsltu_vv, opivv_cmp_check)
|
||||
GEN_OPIVV_TRANS(vmslt_vv, opivv_cmp_check)
|
||||
GEN_OPIVV_TRANS(vmsleu_vv, opivv_cmp_check)
|
||||
GEN_OPIVV_TRANS(vmsle_vv, opivv_cmp_check)
|
||||
|
||||
static bool opivx_cmp_check(DisasContext *s, arg_rmrr *a)
|
||||
{
|
||||
return (vext_check_isa_ill(s) &&
|
||||
vext_check_reg(s, a->rs2, false) &&
|
||||
(vext_check_overlap_group(a->rd, 1, a->rs2, 1 << s->lmul) ||
|
||||
(s->lmul == 0)));
|
||||
}
|
||||
|
||||
GEN_OPIVX_TRANS(vmseq_vx, opivx_cmp_check)
|
||||
GEN_OPIVX_TRANS(vmsne_vx, opivx_cmp_check)
|
||||
GEN_OPIVX_TRANS(vmsltu_vx, opivx_cmp_check)
|
||||
GEN_OPIVX_TRANS(vmslt_vx, opivx_cmp_check)
|
||||
GEN_OPIVX_TRANS(vmsleu_vx, opivx_cmp_check)
|
||||
GEN_OPIVX_TRANS(vmsle_vx, opivx_cmp_check)
|
||||
GEN_OPIVX_TRANS(vmsgtu_vx, opivx_cmp_check)
|
||||
GEN_OPIVX_TRANS(vmsgt_vx, opivx_cmp_check)
|
||||
|
||||
GEN_OPIVI_TRANS(vmseq_vi, 0, vmseq_vx, opivx_cmp_check)
|
||||
GEN_OPIVI_TRANS(vmsne_vi, 0, vmsne_vx, opivx_cmp_check)
|
||||
GEN_OPIVI_TRANS(vmsleu_vi, 1, vmsleu_vx, opivx_cmp_check)
|
||||
GEN_OPIVI_TRANS(vmsle_vi, 0, vmsle_vx, opivx_cmp_check)
|
||||
GEN_OPIVI_TRANS(vmsgtu_vi, 1, vmsgtu_vx, opivx_cmp_check)
|
||||
GEN_OPIVI_TRANS(vmsgt_vi, 0, vmsgt_vx, opivx_cmp_check)
|
||||
|
|
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@ -1396,3 +1396,126 @@ GEN_VEXT_SHIFT_VX(vsra_vx_b, int8_t, int8_t, H1, H1, DO_SRL, 0x7, clearb)
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GEN_VEXT_SHIFT_VX(vsra_vx_h, int16_t, int16_t, H2, H2, DO_SRL, 0xf, clearh)
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GEN_VEXT_SHIFT_VX(vsra_vx_w, int32_t, int32_t, H4, H4, DO_SRL, 0x1f, clearl)
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GEN_VEXT_SHIFT_VX(vsra_vx_d, int64_t, int64_t, H8, H8, DO_SRL, 0x3f, clearq)
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/* Vector Integer Comparison Instructions */
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#define DO_MSEQ(N, M) (N == M)
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#define DO_MSNE(N, M) (N != M)
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#define DO_MSLT(N, M) (N < M)
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#define DO_MSLE(N, M) (N <= M)
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#define DO_MSGT(N, M) (N > M)
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#define GEN_VEXT_CMP_VV(NAME, ETYPE, H, DO_OP) \
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void HELPER(NAME)(void *vd, void *v0, void *vs1, void *vs2, \
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CPURISCVState *env, uint32_t desc) \
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{ \
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uint32_t mlen = vext_mlen(desc); \
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uint32_t vm = vext_vm(desc); \
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||||
uint32_t vl = env->vl; \
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uint32_t vlmax = vext_maxsz(desc) / sizeof(ETYPE); \
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||||
uint32_t i; \
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\
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for (i = 0; i < vl; i++) { \
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ETYPE s1 = *((ETYPE *)vs1 + H(i)); \
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ETYPE s2 = *((ETYPE *)vs2 + H(i)); \
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if (!vm && !vext_elem_mask(v0, mlen, i)) { \
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continue; \
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} \
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vext_set_elem_mask(vd, mlen, i, DO_OP(s2, s1)); \
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} \
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for (; i < vlmax; i++) { \
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vext_set_elem_mask(vd, mlen, i, 0); \
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} \
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}
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GEN_VEXT_CMP_VV(vmseq_vv_b, uint8_t, H1, DO_MSEQ)
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GEN_VEXT_CMP_VV(vmseq_vv_h, uint16_t, H2, DO_MSEQ)
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GEN_VEXT_CMP_VV(vmseq_vv_w, uint32_t, H4, DO_MSEQ)
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GEN_VEXT_CMP_VV(vmseq_vv_d, uint64_t, H8, DO_MSEQ)
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GEN_VEXT_CMP_VV(vmsne_vv_b, uint8_t, H1, DO_MSNE)
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GEN_VEXT_CMP_VV(vmsne_vv_h, uint16_t, H2, DO_MSNE)
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GEN_VEXT_CMP_VV(vmsne_vv_w, uint32_t, H4, DO_MSNE)
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GEN_VEXT_CMP_VV(vmsne_vv_d, uint64_t, H8, DO_MSNE)
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GEN_VEXT_CMP_VV(vmsltu_vv_b, uint8_t, H1, DO_MSLT)
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GEN_VEXT_CMP_VV(vmsltu_vv_h, uint16_t, H2, DO_MSLT)
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GEN_VEXT_CMP_VV(vmsltu_vv_w, uint32_t, H4, DO_MSLT)
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GEN_VEXT_CMP_VV(vmsltu_vv_d, uint64_t, H8, DO_MSLT)
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GEN_VEXT_CMP_VV(vmslt_vv_b, int8_t, H1, DO_MSLT)
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GEN_VEXT_CMP_VV(vmslt_vv_h, int16_t, H2, DO_MSLT)
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GEN_VEXT_CMP_VV(vmslt_vv_w, int32_t, H4, DO_MSLT)
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GEN_VEXT_CMP_VV(vmslt_vv_d, int64_t, H8, DO_MSLT)
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GEN_VEXT_CMP_VV(vmsleu_vv_b, uint8_t, H1, DO_MSLE)
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GEN_VEXT_CMP_VV(vmsleu_vv_h, uint16_t, H2, DO_MSLE)
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||||
GEN_VEXT_CMP_VV(vmsleu_vv_w, uint32_t, H4, DO_MSLE)
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GEN_VEXT_CMP_VV(vmsleu_vv_d, uint64_t, H8, DO_MSLE)
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GEN_VEXT_CMP_VV(vmsle_vv_b, int8_t, H1, DO_MSLE)
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||||
GEN_VEXT_CMP_VV(vmsle_vv_h, int16_t, H2, DO_MSLE)
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||||
GEN_VEXT_CMP_VV(vmsle_vv_w, int32_t, H4, DO_MSLE)
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||||
GEN_VEXT_CMP_VV(vmsle_vv_d, int64_t, H8, DO_MSLE)
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#define GEN_VEXT_CMP_VX(NAME, ETYPE, H, DO_OP) \
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void HELPER(NAME)(void *vd, void *v0, target_ulong s1, void *vs2, \
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CPURISCVState *env, uint32_t desc) \
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||||
{ \
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||||
uint32_t mlen = vext_mlen(desc); \
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||||
uint32_t vm = vext_vm(desc); \
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||||
uint32_t vl = env->vl; \
|
||||
uint32_t vlmax = vext_maxsz(desc) / sizeof(ETYPE); \
|
||||
uint32_t i; \
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||||
\
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||||
for (i = 0; i < vl; i++) { \
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||||
ETYPE s2 = *((ETYPE *)vs2 + H(i)); \
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||||
if (!vm && !vext_elem_mask(v0, mlen, i)) { \
|
||||
continue; \
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||||
} \
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||||
vext_set_elem_mask(vd, mlen, i, \
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||||
DO_OP(s2, (ETYPE)(target_long)s1)); \
|
||||
} \
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||||
for (; i < vlmax; i++) { \
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||||
vext_set_elem_mask(vd, mlen, i, 0); \
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||||
} \
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||||
}
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GEN_VEXT_CMP_VX(vmseq_vx_b, uint8_t, H1, DO_MSEQ)
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GEN_VEXT_CMP_VX(vmseq_vx_h, uint16_t, H2, DO_MSEQ)
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GEN_VEXT_CMP_VX(vmseq_vx_w, uint32_t, H4, DO_MSEQ)
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||||
GEN_VEXT_CMP_VX(vmseq_vx_d, uint64_t, H8, DO_MSEQ)
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GEN_VEXT_CMP_VX(vmsne_vx_b, uint8_t, H1, DO_MSNE)
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GEN_VEXT_CMP_VX(vmsne_vx_h, uint16_t, H2, DO_MSNE)
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GEN_VEXT_CMP_VX(vmsne_vx_w, uint32_t, H4, DO_MSNE)
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||||
GEN_VEXT_CMP_VX(vmsne_vx_d, uint64_t, H8, DO_MSNE)
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GEN_VEXT_CMP_VX(vmsltu_vx_b, uint8_t, H1, DO_MSLT)
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GEN_VEXT_CMP_VX(vmsltu_vx_h, uint16_t, H2, DO_MSLT)
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||||
GEN_VEXT_CMP_VX(vmsltu_vx_w, uint32_t, H4, DO_MSLT)
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||||
GEN_VEXT_CMP_VX(vmsltu_vx_d, uint64_t, H8, DO_MSLT)
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||||
GEN_VEXT_CMP_VX(vmslt_vx_b, int8_t, H1, DO_MSLT)
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||||
GEN_VEXT_CMP_VX(vmslt_vx_h, int16_t, H2, DO_MSLT)
|
||||
GEN_VEXT_CMP_VX(vmslt_vx_w, int32_t, H4, DO_MSLT)
|
||||
GEN_VEXT_CMP_VX(vmslt_vx_d, int64_t, H8, DO_MSLT)
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GEN_VEXT_CMP_VX(vmsleu_vx_b, uint8_t, H1, DO_MSLE)
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||||
GEN_VEXT_CMP_VX(vmsleu_vx_h, uint16_t, H2, DO_MSLE)
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GEN_VEXT_CMP_VX(vmsleu_vx_w, uint32_t, H4, DO_MSLE)
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||||
GEN_VEXT_CMP_VX(vmsleu_vx_d, uint64_t, H8, DO_MSLE)
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GEN_VEXT_CMP_VX(vmsle_vx_b, int8_t, H1, DO_MSLE)
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GEN_VEXT_CMP_VX(vmsle_vx_h, int16_t, H2, DO_MSLE)
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GEN_VEXT_CMP_VX(vmsle_vx_w, int32_t, H4, DO_MSLE)
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GEN_VEXT_CMP_VX(vmsle_vx_d, int64_t, H8, DO_MSLE)
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GEN_VEXT_CMP_VX(vmsgtu_vx_b, uint8_t, H1, DO_MSGT)
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GEN_VEXT_CMP_VX(vmsgtu_vx_h, uint16_t, H2, DO_MSGT)
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GEN_VEXT_CMP_VX(vmsgtu_vx_w, uint32_t, H4, DO_MSGT)
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GEN_VEXT_CMP_VX(vmsgtu_vx_d, uint64_t, H8, DO_MSGT)
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GEN_VEXT_CMP_VX(vmsgt_vx_b, int8_t, H1, DO_MSGT)
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GEN_VEXT_CMP_VX(vmsgt_vx_h, int16_t, H2, DO_MSGT)
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GEN_VEXT_CMP_VX(vmsgt_vx_w, int32_t, H4, DO_MSGT)
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GEN_VEXT_CMP_VX(vmsgt_vx_d, int64_t, H8, DO_MSGT)
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